Altera EPM3128ATC100-10N — Dispositivo logico programmabile complesso (CPLD) MAX 3000A, 2.500 gate utilizzabili, 128 macrocelle, ritardo pin-to-pin di 10 ns, 3.0–3.6 V, contenitore TQFP a 100 pin, codice data 20+, vassoio da 37 pezzi. PLD basato su EEPROM CMOS con programmabilità in-system (ISP) da 3.3 V tramite interfaccia JTAG, supporto I/O MultiVolt per sistemi a 2.5 V, 3.3 V e 5.0 V e ottimizzazione programmabile velocità/potenza per macrocella.
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Panoramica del prodotto
| Codice articolo | EPM3128ATC100-10N |
| Produttore | Altera (Intel) |
| Codice data | 20+ |
| Quantità | 37 pezzi (vassoio) |
| Famiglia di dispositivi | MAX 3000A |
| Tipo di dispositivo | Dispositivo logico programmabile complesso (CPLD) |
| Architettura | Basata su EEPROM CMOS |
| Gate utilizzabili | 2.500 |
| Macrocelle | 128 |
| Blocchi di array logici (LAB) | 8 |
| Pin I/O utente massimi | 98 (TQFP a 100 pin) |
| Ritardo pin-to-pin (tPD) | 10 ns (grado di velocità –10) |
| Frequenza massima di clock | 98.0 MHz (interna, grado di velocità –10) |
| Tensione di alimentazione (VCCINT) | 3.0 V – 3.6 V (3.3 V nominali) |
| Compatibilità tensione I/O | 2.5 V, 3.3 V e 5.0 V (I/O MultiVolt) |
| Programmabilità in-system (ISP) | 3.3 V tramite interfaccia JTAG IEEE Std. 1149.1 |
| Memoria di configurazione | EEPROM (riprogrammabile fino a 100 volte) |
| Temperatura operativa | –40 °C a +85 °C (industriale) |
| Contenitore | TQFP a 100 pin (TC100) |
| Conformità RoHS | Sì |
| Condizione | Nuovo — nella confezione originale (OVP) |
Applicazioni
- Logica di interfaccia, interfaccia bus e decodifica degli indirizzi in sistemi embedded e industriali
- Implementazione di macchine a stati e logica combinatoria in applicazioni di controllo
- Integrazione di sistemi a tensione mista che richiedono compatibilità I/O a 2.5 V, 3.3 V e 5.0 V
- Logica aggiornabile sul campo in apparecchiature di telecomunicazione, automobilistiche e industriali tramite ISP
Spedizione
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- Spedizione gratuita in Germania
Garanzia e conformità
- Garanzia di 12 mesi inclusa
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